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『リードソロモンExpress』は、誤り位置多項式の計算および誤り値の計算をパイプライン処理することで、スループット1Gbps 以上を実現した誤り訂正符号化/復号(Encoder/Decoder)IPコアです。 可変データブロック長に対応しています。 【特長】 ■スループット１Gbps 以上を実現 ■可変データブロック長に対応 ■チェックビットのByte 数や原始多項式・生成多項式は ご要望に応じてカスタマイズが可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『リードソロモン Encoder/Decoder』は、無線機器、xDSLモデム、デジタルTV など幅広い分野で通信品質を向上させる目的で使用されているリードソロモン(Reed-Solomon)方式の誤り訂正符号化/復号IPコアです。 可変データブロック長に対応しています。 【特長】 ■可変データブロック長に対応 ■チェックビットのByte数や原始多項式･生成多項式は、 ご要望に応じてカスタマイズが可能 ■ビット／バイトインターリーブ機能の追加も可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『マルチチャネル対応 ADPCMトランスコーダ』は、ITU-T 勧告G.726規格に準拠したFPGA向けADPCMトランスコーダIPの64チャネル対応版です。 PCMコーデックと組み合わせることで、ADPCMコーデックLSIと置き換えることが可能です。 【特長】 ■ITU-T 勧告G.726準拠 32kbps ADPCM トランスコーダ ■μ-law / A-law 両対応 ■64チャネル対応 ■メモリによる外部インタフェース ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『ビタビDecoder』は、代表的な誤り訂正符号方式として広く使われている畳み込み符号に対応するビタビ復号(Viterbi-Decoder)のFPGA用IPコアです。 軟判定復号／硬判定復号、双方に対応しています。 IEEE802.11a をはじめとする多くの通信規格で標準採用されている拘束長７（171oct、133oct）の畳み込み符号に対応。 さまざまなアプリケーションに適用可能です。 【特長】 ■最大回線速度 約110Mbps を実現し、IEEE802.11a 規格に適応可能 ■デパンクチャ機能内蔵 ■符号化率 1/2，2/3，3/4，4/5，5/6，6/7，7/8 に対応 ■符号化率に対応した速度変換ブロックを実装 ■メモリブロック（EAB）を使用しない構成 ■パラメータにより、トレースバック量を設定可能 ■軟判定ビット幅の設定が可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『SH3対応PCIホストブリッジ』は、ルネサス エレクトロニクス社製 SH3のローカルバスにPCIインターフェースを持つデバイスを接続します。 必要性の高い機能のみで構成していますので、規模が小さく実装が容易です。 【特長】 ■PCI Rev 2.2 に準拠 ■ルネサス エレクトロニクス社製 SH3のローカルバスに直接接続が可能 ■マスタ/ターゲット動作に対応 ■PCIデバイスがバスマスタとなり、DMA転送が可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『PCMコーデック』は、ITU-T G.711規格に準拠したFPGA用のリニアPCMコーデックIPです。 一般的なA/D，D/Aを使用することにより、市販のPCMコーデックLSIに比べ、ディスコンのリスクを軽減することができます。 【特長】 ■ITU-T G.711準拠 ■リニアPCM ⇔ μ-law/A-law PCM変換可能 ■回路規模が小さいため小規模FPGAに搭載可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『MPSC PLD』はNEC製μPD72001互換を目指したマルチ・プロトコル・シリアル・コントローラ（MPSC）のFPGA用IPコアです。 uPD72001同様、調歩同期、COP、BOPの3種のプロトコルをサポートしています。 【特長】 ■NEC製μPD72001を使用しているシステムに制御ソフトウェアを 大幅に変更せずに置き換えることが可能 ■RTL(VHDL)またはFPGA用ROMデータにてご提供 ■必要なプロトコルおよびチャネル数のみに限定し、 より小規模で安価なFPGAに実装することも可能（カスタマイズ対応） ■5Vインタフェース対応機能（レベル変換用外部バスバッファ制御機能）搭載 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『DES（TripleDES）』は、64bitデータを処理単位とした共通鍵暗号DESの暗号化/復号エンジンIPコアです。 外部制御回路も含め、お客様のご要望にあわせてカスタマイズを行いご提供することが可能なため、FPGAの回路規模を抑えることができます。 【特長】 ■アルゴリズムは米国規格協会（ANSI X3.92）規格に準拠 ■DES の利用モードは米国規格協会（ANSI X3.106）規格のECB、CBC モードに準拠 ■Triple-DES の利用モードは米国規格協会（ANSI X9.52）規格のTECB、TCBC モードに準拠 ■Triple-DES は2key/3key の暗号鍵を選択可能 ■DES / Triple‐DES による暗号/復号エンジンを１パッケージにて実現 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『AHB対応PCIホストブリッジ』は、AMBA AHBとPCIバスを接続するPCIホストブリッジで、AHBアーキテクチャのシステムから様々なPCIデバイスを容易に利用することが可能です。 必要性の高い機能のみで構成してるため、規模が小さく実装も容易です。 【特長】 ■PCI Rev 2.2 に準拠 ■AMBA 仕様書Rev2.0 に準拠 ■マスタ/ターゲット動作に対応 ※マスタ動作のみ、ターゲット動作のみも対応可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『AES』は、標準的な共通鍵暗号AES暗号化／復号エンジンのFPGA用IPコアです。 DESより高い安全性で、Triple-DESより高速な特長を持つ、128bitを処理単位とした共通鍵ブロック暗号です。 アルゴリズムは米国連邦情報処理標準規格（NIST FIPS-197）に準拠しています。 暗号鍵長は、AES-128/AES-192/AES-256の3種類をサポートしています。 【特長】 ■NIST FIPS-197 準拠 ■暗号化／復号を１パッケージで実現 ■ECB/CBC/CTR の動作モードをサポート ■128bit/192bit/256bit の鍵拡張機能を標準搭載 ■最大処理速度 約110Mbpsを実現し、ネットワークセキュリティ機器への応用が可能 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『ADPCMトランスコーダ』は、ITU-T 勧告G.726規格に準拠したFPGA向けADPCMトランスコーダコアIPです。 PCMコーデックと組み合わせることで、ADPCMコーデックLSIと置き換えることが可能です。 Verilog-HDL 言語で設計しています。VHDL 言語での対応についてはご相談ください。 また、マクロ（ネットリスト）によるご提供やROM 形式でのご提供も可能です。 【特長】 ■ITU-T 勧告G.726準拠 ■PCM符号64kbps ⇔ 32kbps ADPCM変換 ■64kbps×1チャネルを32kbps×2チャネル化 ■標本化周波数8kHzクロック動作 ■エンコーダ／デコーダ独立回路 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
『ADC制御機能付 PCMコーデック』は、Texas Instruments製ADC IC（TLV320AIC11K）との組み合わせにより実現した、FPGA用のPCMコーデックIPです。 Verilog-HDL 言語で設計しています。VHDL 言語での対応についてはご相談ください。 また、マクロ（ネットリスト）によるご提供やROM 形式でのご提供も可能です。 【特長】 ■ITU-T G.711 準拠 ■リニアPCM ⇔μ-law/A-lawPCM 変換 ■TLV320AIC11K 内蔵の音声帯域フィルタ回路を利用 ※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
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